賦盈科技股份有限公司

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資深硬體系統工程師

1. FPGA 系統與通訊時序設計： >>負責 FPGA（如 Xilinx UltraScale+ 系列）與高速 ADC 之間的序列式介面（如 LVDS）、時脈分配及底層通訊模式設計。 >>執行 FPGA 時序約束 (Constraints/XDC) 與時序收斂 (Timing Closure)，確保高 速資料傳輸與演算法硬體加速的穩定性。 2. 電源完整性與電路設計 (Power Management)：…