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负责 SoC 子系统或 IP 模块架构规划与设计,输出规格文档 使用 RTL 完成数字电路开发,保障设计满足 PPA 指标要求 熟悉数字前端全流程设计工作,按节点完成交付 协同验证、后端、软件等团队,推进子系统与 IP 模块顺利落地交付 精通 Verilog/SystemVerilog,具备扎实的 RTL 编码功底 熟练使用 VCS、Verdi、Spyglass等主流 EDA 工具 拥有复杂多子系统 SoC…
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