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1. 调度与内存管理:实现 Runtime 内存分配器、执行队列、实时调度策略(确定性延迟/抢占/QoS);支持动态shape、多模型并发与资源隔离。 2. Executable 加载与执行:对接编译产物(executable)的加载、校验与执行路径;与编译团队对齐ABI、内存模型与执行语义。 3. 工程化与性能验证:维护 Runtime 单测、集成测试与性能基准;在仿真/FPGA/回片环境中验证执行正确性与调度延迟,参与性能攻关与…
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负责SoC LPDDR内存子系统顶层架构设计、内存控制器/PHY IP选型、模块划分、总线交互与拓扑方案制定,输出子系统规格书、架构文档、时序与功耗规范,完成全流程集成落地与技术评审。 精通LPDDR4X/5/5X/6主流JEDEC协议标准,熟练掌握内存PHY链路训练、时序配置、速率适配、读写校准机制,解决高速内存链路误码、训练失败、降频、稳定性异常、兼容性问题,保障全速率稳定运行。…
职责概述 负责下一代NPU 架构性能定义,仿真和原型验证,为自研NPU竞争力; 负责定义NPU架构原型和架构,估算模型算力,带宽,算子需求,能够将高层算法映射到硬件性能指标,评估应用需求,形成Microbenchmark,发现性能瓶颈 与算法,编译器团队沟通和紧密合作 技术要求 5年以上高性能处理器或AI加速器性能架构经验,具备至少一次完整芯片项目的性能建模与评估实践…
·负责下一代高性能SoC的系统级验证策略制定与工程实现,涵盖多核CPU子系统、NPU/GPU加速器、DDR存储接口、高速IO(PCIe/USB/Display/Ethernet)及安全子系统等关键模块的完整验证闭环。 ·主导从验证计划制定、环境搭建、用例开发到系统级回归测试及收敛 sign-off 的全流程,确保SoC在功能正确性、系统性能、功耗完整性及跨IP协同上的高质量交付,支撑复杂SOC芯片的一次流片成功。…
·负责下一代高性能SoC的系统级架构设计与工程实现,支撑具身智能芯片的全芯片集成与量产交付。 ·主导从系统架构定义、IP集成、总线/互连规划到物理实现协同的全流程,确保SoC在性能、功耗、面积(PPA)及良率上的最优平衡,推动芯片在先进工艺节点下的成功流片与规模量产。 ·具备3年以上复杂AP芯片、大型AI芯片或高性能SoC开发经验,且至少主导过一次从架构定义到量产(Mass Production)的完整SoC设计周期…
作为SoC NoC子系统架构工程师,您将负责设计复杂SoC芯片中的片上网络架构,构建高带宽、低延迟、可扩展的数据传输基础设施,支撑多核CPU、GPU、NPU、ISP及各类专用加速器的高效互联与协同工作NoC IP选型和定制定义NoC与计算单元、存储子系统、I/O接口的集成方案建立流量模型、延迟分析、带宽均衡评估体系,支撑架构决策与瓶颈定位推动NoC的低功耗设计与中后端紧密合作,推动自研高带宽NoC研发。…
1. ISS 开发与维护:实现与维护指令集功能模拟器——ISA 指令语义建模、设备/片上内存与 DMA 抽象、编译产物(executable)加载与执行、golden 结果比对;与编译团队对齐 ABI 与执行接口,支撑单算子至图级功能正确性验证。 2. Cycle-Approximate 仿真开发:在团队制定的仿真架构下,开发与维护 cycleapproximate…
1. 驱动模块实现:在明确规格下实现驱动子模块——寄存器抽象、DMA 提交、中断处理、固件加载、设备 ioctl 等;维护模块功能正确性与代码质量。 2. AI-Native 驱动开发:使用 RAG(寄存器手册/架构 spec) + LLM 生成驱动样板与单测,人工审核后合入;持续沉淀可复用的驱动模式与排障经验。 3. 测试与稳定性验证:执行设备级测试、稳定性长跑与回归;回片后参与 Bring-up 问题复现、Bug…
1. Auto-tuning 框架:设计并实现 auto-tuning 框架——搜索空间定义、cost model、编译参数枚举、调优结果缓存与最优配置推荐;覆盖核心算子的自动调参需求。 2. 编译器调试基础设施:建设 IR 可视化、Pass 流水线追踪、编译产物 diff 与性能归因工具;集成到编译与算子工程师日常调试流程。 3. 性能回归与 CI 对接:维护性能回归数据集、看板与报告模板;对接仿真与测试团队的CI…
1. 手写算子实现与优化:实现并优化指定算子(GEMM/Conv/Attention/扩散采样等)的多种shape/dtype/layout 变体;结合tiling、数据复用与片上驻留策略开展微架构级调优,构建高性能算子库; 2. 性能验证与模板回流:编写算子单测、精度对比与性能 benchmark;将验证过的高性能tiling、数据复用 pattern 贡献为 codegen…
1. 端到端测试工程平台:建设并维护覆盖 模型/算子 → 编译 → ISS(功能) → cycleapprox(性能) → (可选)FPGA → 硬件在环 的每日 CI 与回归门禁;定义精度/性能/稳定性基准、阈值与签收标准;管理测试数据集、golden/baseline 版本、报告模板与问题归因流水线。 2. LLM-Native 高效开发平台:制定内/外网代码大模型接入方案、构建领域 RAG 知识库(ISA/架构…
1. 框架前端与图导入:选型并搭建框架前端及图导入的技术路线,定义算子语义层规范(op 定义/分解/规范化),与编译器的lowering技术路线对齐。 2. 量化与精度工程:制定量化策略初稿(INT8/INT4/FP8、PTQ/QAT)与精度评估/对齐方法论,建立模型级与算子级精度回归基线,为芯片投片前后的精度风险提供可量化依据。 3.…
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